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32 Mbit Multi-Purpose Flash Plus
A Microchip Technology Company
SST39VF3201C / SST39VF3202C
Preliminary Specifications
T BP
ADDRESSES
555
2AA
555
ADDR
T AH
T CP
WE#
T AS
T CPH
OE#
T CH
CE#
RY/BY#
T CS
T DS
T BY
T DH
T BR
DQ 15-0
XXAA
XX55
XXA0
DATA
VALID
WORD
(ADDR/DATA)
Note: WP# must be held in proper logic state (V IL or V IH ) 1μs prior to and 1μs after the command sequence.
X can be V IL or V IH , but no other value.
Figure 7: CE# Controlled Program Cycle Timing Diagram
ADDRESS A19-0-AMS-0
T CE
CE#
T OEH
OE#
T OE
WE#
T BY
RY/BY#
1410 F05.0
T OES
DQ7
DATA
DATA#
DATA#
DATA
1410 F06.0
Note: A MS = Most significant address
A MS = A 20 for SST39VF3201C/3202C
Figure 8: Data# Polling Timing Diagram
?2011 Silicon Storage Technology, Inc.
22
DS25020A
06/11
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